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Stage Etude de l’implémentation FPGA de générateurs d’aléa (TRNG) (F/H)

ID de l'offre R0078439 Date de publication 15/11/2019 Lieu: Rennes, Bretagne, France
Full time, Stage

QUI SOMMES-NOUS ?

Thales propose des systèmes d’information et de communication sécurisés et interopérables pour les forces armées, les forces de sécurité et les opérateurs d’importance vitale. Ces activités, qui regroupent radiocommunications, réseaux, systèmes de protection, systèmes d’information critiques et cybersécurité, répondent aux besoins de marchés où l’utilisation des nouvelles technologies numériques est déterminante. Thales intervient tout au long de la chaîne de valeur, des équipements aux systèmes en passant par le soutien logistique et les services associés.

Le site de Gennevilliers est le cœur des activités de conception, et de développement et de soutien des produits et solutions de radiocommunications des Armées, des systèmes de réseaux d’infrastructures résilients et de communications par satellite, et ainsi que des solutions de cybersécurité.

Stage Bac +5 :Etude de l’implémentation FPGA de générateurs d’aléa (TRNG)(F/H)

Basé à Rennes

6 mois à partir de janvier 2020

QUI ETES-VOUS?

  • Vous êtes étudiant(e) en école d’ingénieur ou équivalent et recherchez un stage de 6 mois ?
  • Vous maîtrisez le langage C, Python et VHDL ?
  • Vous avez des connaissances des outils d’implémentation FPGA ?
  • Vous avez des compétences en mathématiques statistiques ?

Alors ce stage est fait pour vous !

CE QUE NOUS POUVONS ACCOMPLIR ENSEMBLE :

Au sein de la division Sécurité des Technologies de l’Information, vous intégrez le service Composants et Cryptographie en charge de développer des composants de sécurité (FPGA/ASIC).

Le caractère aléatoire des TRNG s’appuie sur l’imprédictibilité de certains phénomènes physiques comme le bruit thermique électronique, observable par exemple sous forme de bruit de phase (Jitter) sur des signaux d’horloges.

Ce stage a pour objet d’étudier et de tester sur FPGA une solution de caractérisation embarquée du bruit de phase d’une horloge issue d’une PLL via la technique du « coherent-sampling » (cf. [1] pour un exemple de mise en œuvre de cette technique).

A ce titre, vous avez pour missions :

- la réalisation tout d’abord d’un état de l’art des publications académiques sur le sujet afin de spécifier la solution à implémenter

- l’implémentation de cette solution sous forme de logique synthétisée dans un FPGA XILINX Kintex 7, et d’outillages sur PC (scripts)

- la comparaison des caractéristiques de Jitter obtenues (profil de distribution et écart-type) avec celles annoncées par le fournisseur du FPGA et avec celles disponibles dans la littérature académique

- la proposition et l’implémentation des améliorations de la solution, permettant de caractériser la corrélation temporelle de l’évolution de la phase

[1]: “Testing of PLL-based True Random Number Generator in Changing Working Conditions” - SIMKA, DRUTAROVSKY, FISCHER

Innovation, passion, ambition : rejoignez Thales et créez le monde de demain, dès aujourd’hui.


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À propos de notre emplacement

Rennes Courrouze, France

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